File:CMOS NAND Layout.svg
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原始文件 （SVG文件，尺寸为294 × 587像素，文件大小：12 KB）
摘要
| 描述 |
English: The physical layout of a CMOS NAND circuit. The larger regions of N-type diffusion and P-type diffusion are part of the transistors. The two smaller regions on the left are taps to prevent latchup.
עברית: שער לוגי מסוג NAND ממבט על.
Polski: budowa bramki NAND CMOS.
Română: Aranjamentul fizic al unei porţi NAND CMOS.
中文：CMOS与非门的布图. CMOS NAND Layout for chip |
| 日期 | 2006年9月7日 (原始上传日期) |
| 来源 | 本檔案是從en.wikipedia轉移到維基共享資源。 |
| 作者 | 英语维基百科的Jamesm76 |
| 其他版本 | 此文件衍生的作品： CMOS AND Silicon.svg |
许可协议
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原始上传日志
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- 2006-09-07 23:46 Jamesm76 294×587×0 (11839 bytes) I am the author and I release this to the public domain.
- 2006-09-07 23:27 Jamesm76 294×587×0 (11827 bytes) SVG drawing of a CMOS NAND gate replacing the older PNG version I had previously uploaded ("CMOS NAND Layout.png"). I am the author and I release this to the public domain.
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| 日期/时间 | 缩略图 | 大小 | 用户 | 备注 | |
|---|---|---|---|---|---|
| 当前 | 2007年10月19日 (五) 20:46 | | 294 × 587（12 KB） | Prolineserver | {{Information |Description=''no original description'' |Source=Originally from [http://en.wikipedia.org en.wikipedia]; description page is/was [http://en.wikipedia.org/w/index.php?title=Image%3ACMOS_NAND_Layout.svg here]. |Date=2006-09-07 (first version); |
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